74ls74芯片引脚图（74ls74）

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1、112是2JK触发器，第一引脚是第一个触发器的时钟脉冲CP1，2脚是K1,3脚是J1，4脚是置位端，低电平有效（即4脚为低时输出位高），5脚为Q1,6脚为Q1，7脚为第二个触发器的反输出Q2，8脚接地，9脚为Q2,10脚为第二个出发器的置位端，11为J2,12为K2，13为第二个触发器的时钟脉冲CP2，14为第二个触发器的复位端低电平有效（即14脚为低时输出位低），15为第一个触发器的复位的，16为电源VCC。

2、 74为2个D触发器，1脚为第一个触发器的复位端低电平有效，2脚为D1，3脚为第一个触发器的时钟CP1,4脚为第一个触发器的置位端低电平有效，5脚为Q1，6脚为Q1，7脚接地GND,8脚为Q2，9脚为Q2，10脚为第二个触发器的置位端低电平有效，11脚为第二个触发器的时钟CP2,12脚为D2，13脚第二个触发器的复位端低电平有效，14脚为电源VCC。

3、注意在实际使用是两个芯片的置位和复位端都要接高电平。

本文到此讲解完毕了，希望对大家有帮助。